Verilog

Prof. Dr. Bernhard Hoppe arbeitete von 1986-1989 bei den Siemens Forschungslaboratorien in München und anschließend für vier Jahre am IC-Design-Zentrum der VDO Adolf Schindling. Seit 1993 ist er Professor für Elektrotechnik an der FH Darmstadt und dort seit 2002 Leiter des internationalen Studiengangs "Master of Science in Electrical Engineering".

- Einführung: Geschichte der Sprache; Was sind HDLs; Vergleich Verilog/VHDL; Normung der Sprache durch IEEE als Verilog 2001 - Designmethoden für digitale Schaltungen; Implementierungstechniken (ASIC, FPGA etc.) - Verilog-Grundlagen: Primitive, Datentypen, Operatoren - Aufbau von Verilog-Modellen - Simulation von Schaltungsmodellen in Verilog, Signalgeneratoren und Testbenches - Strukturelle Modelle und Hierarchien - Verhaltensmodellierung mit Verilog - Zustandsautomaten und Datenpfadmodelle - Designbeispiele - Vergleich Verilog/VHDL - Cosimulation von gemischten Verilog/VHDL-Modellen - Anhänge

"Das Buch kann mit gutem Gewissen jedem empfohlen werden, der sich mit Verilog von der praktischen Seite vertraut machen und das Werkzeug anwenden will. " Prof. Dr. Ing. habil. R. Paul, TU Hamburg-Harburg "Die komplizierten Inhalte werden in übersichtlichter Weise gut strukturiert und verständlich dargeboten. Beispiele und Übungen inkl. der Lösungen sind im Buch vorhanden. Didaktisch wertvoll!" Dipl.-Ing Siegfried Rössel "Das Buch ist sowohl als Lehrbuch als auch als Nachschlagewerk geeignet. Die Funktion als Lehrwerk unterstreichen die Aufgabenstellungen an den jeweiligen Kapitelenden einschließlich die Lösungen im Anhang. Das Buch stellt dem Leser gut strukturiert nach und nach die Möglichkeiten der Sprache Verilog vor." Prof. Dr. Ing. K. Schumacher, Universität Dortmund